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16 Mbit / 32 Mbit Multi-Purpose Flash Plus
SST39VF1601 / SST39VF3201
A Microchip Technology Company
ADDRESS A MS-0
CE#
OE#
T RC
T CE
T OE
SST39VF1602 / SST39VF3202
Not Recommended for New Designs
T AA
WE#
V IH
T OLZ
T OHZ
DQ 15-0
Note:
T CLZ
HIGH-Z
A MS = Most significant address
T OH
DATA VALID
T CHZ
DATA VALID
HIGH-Z
A MS = A 19 for SST39VF1601/1602 and A 20 for SST39VF3201/3202
1223 F03.3
Figure 4: Read Cycle Timing Diagram
INTERNAL PROGRAM OPERATION STARTS
T BP
ADDRESS A MS-0
5555
2AAA
5555
ADDR
WE#
T AH
T WP
T DH
T AS
T WPH
T DS
OE#
T CH
CE#
T CS
DQ 15-0
XXAA
SW0
XX55
SW1
XXA0
SW2
DATA
WORD
(ADDR/DATA)
Note:
A MS = Most significant address
A MS = A 19 for SST39VF1601/1602 and A 20 for SST39VF3201/3202
WP# must be held in proper logic state (V IL or V IH ) 1 μs prior to and 1 μs after the command sequence
X can be V IL or V IH , but no other value
1223 F04.4
Figure 5: WE# Controlled Program Cycle Timing Diagram
?2011 Silicon Storage Technology, Inc.
18
DS25028A
08/11
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